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웨이퍼 레벨 패키징 및 시스템 인 패키지

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  • 전자 제품 제조를 위한 반도체 장치 제작의 마지막 단계에는 집적 회로(IC)를 ‘패키지’라고 하는 지지 케이스에 캡슐화하기 위한 첨단 패키징이 포함됩니다. 이 패키지는 IC를 회로 기판에 연결하는 전기 접점을 지원합니다. 반도체 산업의 다양한 집적 회로에는 크기, 전력 손실, 현장 작동 조건 및 비용과 같은 매개 변수에 따라 다양한 패키징 유형이 필요합니다. 고급 패키징 기술에는 기존 PCB보다 높은 집적도를 제공하는 BGA, 플립칩, CSP, LGA, PGA는 물론 멀티칩 모듈, 시스템 인 패키지 및 이기종 통합이 포함됩니다.

    이러한 패키징 방법은 시스템 설계자에게 속도, 비용, 기능, 통합 용이성 등 다양한 이점을 제공합니다. 패키징 방법과 기술 요구 사항에 따라 필요한 팬아웃 및 IC 접촉 패드 매핑을 구현하기 위해 다양한 재료를 구조화해야 합니다. 실리콘(TSV), 폴리머, 세라믹, 금속을 포함한 이러한 재료는 모두 유연한 고해상도 리소그래피에서 중요한 역할을 합니다.

    하이델베르그 인스트루먼트의 MLA 300 및 VPG+ 시스템은 유연한 생산 애플리케이션을 위해 설계되었으며 높은 처리량, 자동 왜곡 보정 및 평탄도가 낮은 기판에 대한 자동 초점 추종 기능을 제공합니다. 이 시스템은 다양한 재료를 구조화하여 필요한 팬아웃 및 IC 접촉 패드 매핑을 구현할 수 있으므로 반도체 산업의 다양한 집적 회로에 대한 다양한 패키징 요구 사항을 충족하는 고품질 고급 패키지를 생산할 수 있습니다.

    아래 나열된 제품 페이지에서 시스템에 대해 자세히 알아보세요.

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  • Solutions

전자 제품 제조를 위한 반도체 장치 제작의 마지막 단계에는 집적 회로(IC)를 ‘패키지’라고 하는 지지 케이스에 캡슐화하기 위한 첨단 패키징이 포함됩니다. 이 패키지는 IC를 회로 기판에 연결하는 전기 접점을 지원합니다. 반도체 산업의 다양한 집적 회로에는 크기, 전력 손실, 현장 작동 조건 및 비용과 같은 매개 변수에 따라 다양한 패키징 유형이 필요합니다. 고급 패키징 기술에는 기존 PCB보다 높은 집적도를 제공하는 BGA, 플립칩, CSP, LGA, PGA는 물론 멀티칩 모듈, 시스템 인 패키지 및 이기종 통합이 포함됩니다.

이러한 패키징 방법은 시스템 설계자에게 속도, 비용, 기능, 통합 용이성 등 다양한 이점을 제공합니다. 패키징 방법과 기술 요구 사항에 따라 필요한 팬아웃 및 IC 접촉 패드 매핑을 구현하기 위해 다양한 재료를 구조화해야 합니다. 실리콘(TSV), 폴리머, 세라믹, 금속을 포함한 이러한 재료는 모두 유연한 고해상도 리소그래피에서 중요한 역할을 합니다.

하이델베르그 인스트루먼트의 MLA 300 및 VPG+ 시스템은 유연한 생산 애플리케이션을 위해 설계되었으며 높은 처리량, 자동 왜곡 보정 및 평탄도가 낮은 기판에 대한 자동 초점 추종 기능을 제공합니다. 이 시스템은 다양한 재료를 구조화하여 필요한 팬아웃 및 IC 접촉 패드 매핑을 구현할 수 있으므로 반도체 산업의 다양한 집적 회로에 대한 다양한 패키징 요구 사항을 충족하는 고품질 고급 패키지를 생산할 수 있습니다.

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Application images

Shown here is a Packaging demonstrator, a simulation of chip misalignment in chrome with connector traces exposed by MLA 300 in negative resist.
Shown here is a Packaging demonstrator, a simulation of chip misalignment in chrome with connector traces exposed by MLA 300 in negative resist.
Heidelberg Instruments‘ MLA 300 enables higher interconnect densities by exposing tailored designs matching the exact position of each die.
Heidelberg Instruments‘ MLA 300 enables higher interconnect densities by exposing tailored designs matching the exact position of each die.
Panel 12"x9" exposed with a VPG+ 800 with 2 µm features in 3 µm thick photoresist. (Courtesy of Fraunhofer IZM, Panel Level Consortium 2.0)
Panel 12"x9" exposed with a VPG+ 800 with 2 µm features in 3 µm thick photoresist.
(Courtesy of Fraunhofer IZM, Panel Level Consortium 2.0)
The VPG+ 400 enables the production of Ultra-High Density Polymer RDL* (RDL1st **FO-WLP). (Courtesy of Fraunhofer IZM - ASSID) *Redistribution Line / ** Fan-out Wafer-Level Packaging
The VPG+ 400 enables the production of Ultra-High Density Polymer RDL* (RDL1st **FO-WLP).
(Courtesy of Fraunhofer IZM - ASSID)
*Redistribution Line / ** Fan-out Wafer-Level Packaging
Copper pillars, with a diameter smaller than 1 µm and an aspect ratio of approximately 4:1, are used for chip-to-chip interconnects. Made with a VPG+ 800 after a post process step. (Courtesy of Fraunhofer IZM, Panel Level Consortium 2.0)
Copper pillars, with a diameter smaller than 1 µm and an aspect ratio of approximately 4:1, are used for chip-to-chip interconnects. Made with a VPG+ 800 after a post process step.
(Courtesy of Fraunhofer IZM, Panel Level Consortium 2.0)

suitable Systems

MLA 300 산업용 마스크리스 얼라이너

MLA 300

  • 마스크 없는 얼라이너

최고의 정밀도와 산업 생산 라인과의 원활한 통합으로 유연한 산업 생산에 최적화되어 있습니다.

VPG+ 800 볼륨 패턴 생성기

VPG+ 200, VPG+ 400 및 VPG+ 800

  • 볼륨 패턴 생성기

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